NSIMD documentation
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Addition using saturation

Description

Returns the saturated sum of the two vectors given as arguments

C base API (generic)

#define vadds(a0, a1, type)
#define vadds_e(a0, a1, type, simd_ext)

C advanced API (generic, requires C11)

#define nsimd_adds(a0, a1)

C++ base API (generic)

template <NSIMD_CONCEPT_VALUE_TYPE T> typename simd_traits<T, NSIMD_SIMD>::simd_vector NSIMD_VECTORCALL adds(typename simd_traits<T, NSIMD_SIMD>::simd_vector a0, typename simd_traits<T, NSIMD_SIMD>::simd_vector a1, T);

C++ advanced API

template <NSIMD_CONCEPT_VALUE_TYPE T, NSIMD_CONCEPT_SIMD_EXT SimdExt> pack<T, 1, SimdExt> adds(pack<T, 1, SimdExt> const& a0, pack<T, 1, SimdExt> const& a1);
template <NSIMD_CONCEPT_VALUE_TYPE T, int N, NSIMD_CONCEPT_SIMD_EXT SimdExt> pack<T, N, SimdExt> adds(pack<T, N, SimdExt> const& a0, pack<T, N, SimdExt> const& a1);

C base API (architecture specifics)

AVX2

nsimd_avx2_vf64 NSIMD_VECTORCALL nsimd_adds_avx2_f64(nsimd_avx2_vf64 a0, nsimd_avx2_vf64 a1);
nsimd_avx2_vf32 NSIMD_VECTORCALL nsimd_adds_avx2_f32(nsimd_avx2_vf32 a0, nsimd_avx2_vf32 a1);
nsimd_avx2_vf16 NSIMD_VECTORCALL nsimd_adds_avx2_f16(nsimd_avx2_vf16 a0, nsimd_avx2_vf16 a1);
nsimd_avx2_vi64 NSIMD_VECTORCALL nsimd_adds_avx2_i64(nsimd_avx2_vi64 a0, nsimd_avx2_vi64 a1);
nsimd_avx2_vi32 NSIMD_VECTORCALL nsimd_adds_avx2_i32(nsimd_avx2_vi32 a0, nsimd_avx2_vi32 a1);
nsimd_avx2_vi16 NSIMD_VECTORCALL nsimd_adds_avx2_i16(nsimd_avx2_vi16 a0, nsimd_avx2_vi16 a1);
nsimd_avx2_vi8 NSIMD_VECTORCALL nsimd_adds_avx2_i8(nsimd_avx2_vi8 a0, nsimd_avx2_vi8 a1);
nsimd_avx2_vu64 NSIMD_VECTORCALL nsimd_adds_avx2_u64(nsimd_avx2_vu64 a0, nsimd_avx2_vu64 a1);
nsimd_avx2_vu32 NSIMD_VECTORCALL nsimd_adds_avx2_u32(nsimd_avx2_vu32 a0, nsimd_avx2_vu32 a1);
nsimd_avx2_vu16 NSIMD_VECTORCALL nsimd_adds_avx2_u16(nsimd_avx2_vu16 a0, nsimd_avx2_vu16 a1);
nsimd_avx2_vu8 NSIMD_VECTORCALL nsimd_adds_avx2_u8(nsimd_avx2_vu8 a0, nsimd_avx2_vu8 a1);

SVE512

nsimd_sve512_vf64 NSIMD_VECTORCALL nsimd_adds_sve512_f64(nsimd_sve512_vf64 a0, nsimd_sve512_vf64 a1);
nsimd_sve512_vf32 NSIMD_VECTORCALL nsimd_adds_sve512_f32(nsimd_sve512_vf32 a0, nsimd_sve512_vf32 a1);
nsimd_sve512_vf16 NSIMD_VECTORCALL nsimd_adds_sve512_f16(nsimd_sve512_vf16 a0, nsimd_sve512_vf16 a1);
nsimd_sve512_vi64 NSIMD_VECTORCALL nsimd_adds_sve512_i64(nsimd_sve512_vi64 a0, nsimd_sve512_vi64 a1);
nsimd_sve512_vi32 NSIMD_VECTORCALL nsimd_adds_sve512_i32(nsimd_sve512_vi32 a0, nsimd_sve512_vi32 a1);
nsimd_sve512_vi16 NSIMD_VECTORCALL nsimd_adds_sve512_i16(nsimd_sve512_vi16 a0, nsimd_sve512_vi16 a1);
nsimd_sve512_vi8 NSIMD_VECTORCALL nsimd_adds_sve512_i8(nsimd_sve512_vi8 a0, nsimd_sve512_vi8 a1);
nsimd_sve512_vu64 NSIMD_VECTORCALL nsimd_adds_sve512_u64(nsimd_sve512_vu64 a0, nsimd_sve512_vu64 a1);
nsimd_sve512_vu32 NSIMD_VECTORCALL nsimd_adds_sve512_u32(nsimd_sve512_vu32 a0, nsimd_sve512_vu32 a1);
nsimd_sve512_vu16 NSIMD_VECTORCALL nsimd_adds_sve512_u16(nsimd_sve512_vu16 a0, nsimd_sve512_vu16 a1);
nsimd_sve512_vu8 NSIMD_VECTORCALL nsimd_adds_sve512_u8(nsimd_sve512_vu8 a0, nsimd_sve512_vu8 a1);

SVE

nsimd_sve_vf64 NSIMD_VECTORCALL nsimd_adds_sve_f64(nsimd_sve_vf64 a0, nsimd_sve_vf64 a1);
nsimd_sve_vf32 NSIMD_VECTORCALL nsimd_adds_sve_f32(nsimd_sve_vf32 a0, nsimd_sve_vf32 a1);
nsimd_sve_vf16 NSIMD_VECTORCALL nsimd_adds_sve_f16(nsimd_sve_vf16 a0, nsimd_sve_vf16 a1);
nsimd_sve_vi64 NSIMD_VECTORCALL nsimd_adds_sve_i64(nsimd_sve_vi64 a0, nsimd_sve_vi64 a1);
nsimd_sve_vi32 NSIMD_VECTORCALL nsimd_adds_sve_i32(nsimd_sve_vi32 a0, nsimd_sve_vi32 a1);
nsimd_sve_vi16 NSIMD_VECTORCALL nsimd_adds_sve_i16(nsimd_sve_vi16 a0, nsimd_sve_vi16 a1);
nsimd_sve_vi8 NSIMD_VECTORCALL nsimd_adds_sve_i8(nsimd_sve_vi8 a0, nsimd_sve_vi8 a1);
nsimd_sve_vu64 NSIMD_VECTORCALL nsimd_adds_sve_u64(nsimd_sve_vu64 a0, nsimd_sve_vu64 a1);
nsimd_sve_vu32 NSIMD_VECTORCALL nsimd_adds_sve_u32(nsimd_sve_vu32 a0, nsimd_sve_vu32 a1);
nsimd_sve_vu16 NSIMD_VECTORCALL nsimd_adds_sve_u16(nsimd_sve_vu16 a0, nsimd_sve_vu16 a1);
nsimd_sve_vu8 NSIMD_VECTORCALL nsimd_adds_sve_u8(nsimd_sve_vu8 a0, nsimd_sve_vu8 a1);

CPU

nsimd_cpu_vf64 NSIMD_VECTORCALL nsimd_adds_cpu_f64(nsimd_cpu_vf64 a0, nsimd_cpu_vf64 a1);
nsimd_cpu_vf32 NSIMD_VECTORCALL nsimd_adds_cpu_f32(nsimd_cpu_vf32 a0, nsimd_cpu_vf32 a1);
nsimd_cpu_vf16 NSIMD_VECTORCALL nsimd_adds_cpu_f16(nsimd_cpu_vf16 a0, nsimd_cpu_vf16 a1);
nsimd_cpu_vi64 NSIMD_VECTORCALL nsimd_adds_cpu_i64(nsimd_cpu_vi64 a0, nsimd_cpu_vi64 a1);
nsimd_cpu_vi32 NSIMD_VECTORCALL nsimd_adds_cpu_i32(nsimd_cpu_vi32 a0, nsimd_cpu_vi32 a1);
nsimd_cpu_vi16 NSIMD_VECTORCALL nsimd_adds_cpu_i16(nsimd_cpu_vi16 a0, nsimd_cpu_vi16 a1);
nsimd_cpu_vi8 NSIMD_VECTORCALL nsimd_adds_cpu_i8(nsimd_cpu_vi8 a0, nsimd_cpu_vi8 a1);
nsimd_cpu_vu64 NSIMD_VECTORCALL nsimd_adds_cpu_u64(nsimd_cpu_vu64 a0, nsimd_cpu_vu64 a1);
nsimd_cpu_vu32 NSIMD_VECTORCALL nsimd_adds_cpu_u32(nsimd_cpu_vu32 a0, nsimd_cpu_vu32 a1);
nsimd_cpu_vu16 NSIMD_VECTORCALL nsimd_adds_cpu_u16(nsimd_cpu_vu16 a0, nsimd_cpu_vu16 a1);
nsimd_cpu_vu8 NSIMD_VECTORCALL nsimd_adds_cpu_u8(nsimd_cpu_vu8 a0, nsimd_cpu_vu8 a1);

SVE2048

nsimd_sve2048_vf64 NSIMD_VECTORCALL nsimd_adds_sve2048_f64(nsimd_sve2048_vf64 a0, nsimd_sve2048_vf64 a1);
nsimd_sve2048_vf32 NSIMD_VECTORCALL nsimd_adds_sve2048_f32(nsimd_sve2048_vf32 a0, nsimd_sve2048_vf32 a1);
nsimd_sve2048_vf16 NSIMD_VECTORCALL nsimd_adds_sve2048_f16(nsimd_sve2048_vf16 a0, nsimd_sve2048_vf16 a1);
nsimd_sve2048_vi64 NSIMD_VECTORCALL nsimd_adds_sve2048_i64(nsimd_sve2048_vi64 a0, nsimd_sve2048_vi64 a1);
nsimd_sve2048_vi32 NSIMD_VECTORCALL nsimd_adds_sve2048_i32(nsimd_sve2048_vi32 a0, nsimd_sve2048_vi32 a1);
nsimd_sve2048_vi16 NSIMD_VECTORCALL nsimd_adds_sve2048_i16(nsimd_sve2048_vi16 a0, nsimd_sve2048_vi16 a1);
nsimd_sve2048_vi8 NSIMD_VECTORCALL nsimd_adds_sve2048_i8(nsimd_sve2048_vi8 a0, nsimd_sve2048_vi8 a1);
nsimd_sve2048_vu64 NSIMD_VECTORCALL nsimd_adds_sve2048_u64(nsimd_sve2048_vu64 a0, nsimd_sve2048_vu64 a1);
nsimd_sve2048_vu32 NSIMD_VECTORCALL nsimd_adds_sve2048_u32(nsimd_sve2048_vu32 a0, nsimd_sve2048_vu32 a1);
nsimd_sve2048_vu16 NSIMD_VECTORCALL nsimd_adds_sve2048_u16(nsimd_sve2048_vu16 a0, nsimd_sve2048_vu16 a1);
nsimd_sve2048_vu8 NSIMD_VECTORCALL nsimd_adds_sve2048_u8(nsimd_sve2048_vu8 a0, nsimd_sve2048_vu8 a1);

NEON128

nsimd_neon128_vf64 NSIMD_VECTORCALL nsimd_adds_neon128_f64(nsimd_neon128_vf64 a0, nsimd_neon128_vf64 a1);
nsimd_neon128_vf32 NSIMD_VECTORCALL nsimd_adds_neon128_f32(nsimd_neon128_vf32 a0, nsimd_neon128_vf32 a1);
nsimd_neon128_vf16 NSIMD_VECTORCALL nsimd_adds_neon128_f16(nsimd_neon128_vf16 a0, nsimd_neon128_vf16 a1);
nsimd_neon128_vi64 NSIMD_VECTORCALL nsimd_adds_neon128_i64(nsimd_neon128_vi64 a0, nsimd_neon128_vi64 a1);
nsimd_neon128_vi32 NSIMD_VECTORCALL nsimd_adds_neon128_i32(nsimd_neon128_vi32 a0, nsimd_neon128_vi32 a1);
nsimd_neon128_vi16 NSIMD_VECTORCALL nsimd_adds_neon128_i16(nsimd_neon128_vi16 a0, nsimd_neon128_vi16 a1);
nsimd_neon128_vi8 NSIMD_VECTORCALL nsimd_adds_neon128_i8(nsimd_neon128_vi8 a0, nsimd_neon128_vi8 a1);
nsimd_neon128_vu64 NSIMD_VECTORCALL nsimd_adds_neon128_u64(nsimd_neon128_vu64 a0, nsimd_neon128_vu64 a1);
nsimd_neon128_vu32 NSIMD_VECTORCALL nsimd_adds_neon128_u32(nsimd_neon128_vu32 a0, nsimd_neon128_vu32 a1);
nsimd_neon128_vu16 NSIMD_VECTORCALL nsimd_adds_neon128_u16(nsimd_neon128_vu16 a0, nsimd_neon128_vu16 a1);
nsimd_neon128_vu8 NSIMD_VECTORCALL nsimd_adds_neon128_u8(nsimd_neon128_vu8 a0, nsimd_neon128_vu8 a1);

AVX512_SKYLAKE

nsimd_avx512_skylake_vf64 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_f64(nsimd_avx512_skylake_vf64 a0, nsimd_avx512_skylake_vf64 a1);
nsimd_avx512_skylake_vf32 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_f32(nsimd_avx512_skylake_vf32 a0, nsimd_avx512_skylake_vf32 a1);
nsimd_avx512_skylake_vf16 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_f16(nsimd_avx512_skylake_vf16 a0, nsimd_avx512_skylake_vf16 a1);
nsimd_avx512_skylake_vi64 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_i64(nsimd_avx512_skylake_vi64 a0, nsimd_avx512_skylake_vi64 a1);
nsimd_avx512_skylake_vi32 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_i32(nsimd_avx512_skylake_vi32 a0, nsimd_avx512_skylake_vi32 a1);
nsimd_avx512_skylake_vi16 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_i16(nsimd_avx512_skylake_vi16 a0, nsimd_avx512_skylake_vi16 a1);
nsimd_avx512_skylake_vi8 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_i8(nsimd_avx512_skylake_vi8 a0, nsimd_avx512_skylake_vi8 a1);
nsimd_avx512_skylake_vu64 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_u64(nsimd_avx512_skylake_vu64 a0, nsimd_avx512_skylake_vu64 a1);
nsimd_avx512_skylake_vu32 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_u32(nsimd_avx512_skylake_vu32 a0, nsimd_avx512_skylake_vu32 a1);
nsimd_avx512_skylake_vu16 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_u16(nsimd_avx512_skylake_vu16 a0, nsimd_avx512_skylake_vu16 a1);
nsimd_avx512_skylake_vu8 NSIMD_VECTORCALL nsimd_adds_avx512_skylake_u8(nsimd_avx512_skylake_vu8 a0, nsimd_avx512_skylake_vu8 a1);

AARCH64

nsimd_aarch64_vf64 NSIMD_VECTORCALL nsimd_adds_aarch64_f64(nsimd_aarch64_vf64 a0, nsimd_aarch64_vf64 a1);
nsimd_aarch64_vf32 NSIMD_VECTORCALL nsimd_adds_aarch64_f32(nsimd_aarch64_vf32 a0, nsimd_aarch64_vf32 a1);
nsimd_aarch64_vf16 NSIMD_VECTORCALL nsimd_adds_aarch64_f16(nsimd_aarch64_vf16 a0, nsimd_aarch64_vf16 a1);
nsimd_aarch64_vi64 NSIMD_VECTORCALL nsimd_adds_aarch64_i64(nsimd_aarch64_vi64 a0, nsimd_aarch64_vi64 a1);
nsimd_aarch64_vi32 NSIMD_VECTORCALL nsimd_adds_aarch64_i32(nsimd_aarch64_vi32 a0, nsimd_aarch64_vi32 a1);
nsimd_aarch64_vi16 NSIMD_VECTORCALL nsimd_adds_aarch64_i16(nsimd_aarch64_vi16 a0, nsimd_aarch64_vi16 a1);
nsimd_aarch64_vi8 NSIMD_VECTORCALL nsimd_adds_aarch64_i8(nsimd_aarch64_vi8 a0, nsimd_aarch64_vi8 a1);
nsimd_aarch64_vu64 NSIMD_VECTORCALL nsimd_adds_aarch64_u64(nsimd_aarch64_vu64 a0, nsimd_aarch64_vu64 a1);
nsimd_aarch64_vu32 NSIMD_VECTORCALL nsimd_adds_aarch64_u32(nsimd_aarch64_vu32 a0, nsimd_aarch64_vu32 a1);
nsimd_aarch64_vu16 NSIMD_VECTORCALL nsimd_adds_aarch64_u16(nsimd_aarch64_vu16 a0, nsimd_aarch64_vu16 a1);
nsimd_aarch64_vu8 NSIMD_VECTORCALL nsimd_adds_aarch64_u8(nsimd_aarch64_vu8 a0, nsimd_aarch64_vu8 a1);

AVX512_KNL

nsimd_avx512_knl_vf64 NSIMD_VECTORCALL nsimd_adds_avx512_knl_f64(nsimd_avx512_knl_vf64 a0, nsimd_avx512_knl_vf64 a1);
nsimd_avx512_knl_vf32 NSIMD_VECTORCALL nsimd_adds_avx512_knl_f32(nsimd_avx512_knl_vf32 a0, nsimd_avx512_knl_vf32 a1);
nsimd_avx512_knl_vf16 NSIMD_VECTORCALL nsimd_adds_avx512_knl_f16(nsimd_avx512_knl_vf16 a0, nsimd_avx512_knl_vf16 a1);
nsimd_avx512_knl_vi64 NSIMD_VECTORCALL nsimd_adds_avx512_knl_i64(nsimd_avx512_knl_vi64 a0, nsimd_avx512_knl_vi64 a1);
nsimd_avx512_knl_vi32 NSIMD_VECTORCALL nsimd_adds_avx512_knl_i32(nsimd_avx512_knl_vi32 a0, nsimd_avx512_knl_vi32 a1);
nsimd_avx512_knl_vi16 NSIMD_VECTORCALL nsimd_adds_avx512_knl_i16(nsimd_avx512_knl_vi16 a0, nsimd_avx512_knl_vi16 a1);
nsimd_avx512_knl_vi8 NSIMD_VECTORCALL nsimd_adds_avx512_knl_i8(nsimd_avx512_knl_vi8 a0, nsimd_avx512_knl_vi8 a1);
nsimd_avx512_knl_vu64 NSIMD_VECTORCALL nsimd_adds_avx512_knl_u64(nsimd_avx512_knl_vu64 a0, nsimd_avx512_knl_vu64 a1);
nsimd_avx512_knl_vu32 NSIMD_VECTORCALL nsimd_adds_avx512_knl_u32(nsimd_avx512_knl_vu32 a0, nsimd_avx512_knl_vu32 a1);
nsimd_avx512_knl_vu16 NSIMD_VECTORCALL nsimd_adds_avx512_knl_u16(nsimd_avx512_knl_vu16 a0, nsimd_avx512_knl_vu16 a1);
nsimd_avx512_knl_vu8 NSIMD_VECTORCALL nsimd_adds_avx512_knl_u8(nsimd_avx512_knl_vu8 a0, nsimd_avx512_knl_vu8 a1);

SSE2

nsimd_sse2_vf64 NSIMD_VECTORCALL nsimd_adds_sse2_f64(nsimd_sse2_vf64 a0, nsimd_sse2_vf64 a1);
nsimd_sse2_vf32 NSIMD_VECTORCALL nsimd_adds_sse2_f32(nsimd_sse2_vf32 a0, nsimd_sse2_vf32 a1);
nsimd_sse2_vf16 NSIMD_VECTORCALL nsimd_adds_sse2_f16(nsimd_sse2_vf16 a0, nsimd_sse2_vf16 a1);
nsimd_sse2_vi64 NSIMD_VECTORCALL nsimd_adds_sse2_i64(nsimd_sse2_vi64 a0, nsimd_sse2_vi64 a1);
nsimd_sse2_vi32 NSIMD_VECTORCALL nsimd_adds_sse2_i32(nsimd_sse2_vi32 a0, nsimd_sse2_vi32 a1);
nsimd_sse2_vi16 NSIMD_VECTORCALL nsimd_adds_sse2_i16(nsimd_sse2_vi16 a0, nsimd_sse2_vi16 a1);
nsimd_sse2_vi8 NSIMD_VECTORCALL nsimd_adds_sse2_i8(nsimd_sse2_vi8 a0, nsimd_sse2_vi8 a1);
nsimd_sse2_vu64 NSIMD_VECTORCALL nsimd_adds_sse2_u64(nsimd_sse2_vu64 a0, nsimd_sse2_vu64 a1);
nsimd_sse2_vu32 NSIMD_VECTORCALL nsimd_adds_sse2_u32(nsimd_sse2_vu32 a0, nsimd_sse2_vu32 a1);
nsimd_sse2_vu16 NSIMD_VECTORCALL nsimd_adds_sse2_u16(nsimd_sse2_vu16 a0, nsimd_sse2_vu16 a1);
nsimd_sse2_vu8 NSIMD_VECTORCALL nsimd_adds_sse2_u8(nsimd_sse2_vu8 a0, nsimd_sse2_vu8 a1);

SSE42

nsimd_sse42_vf64 NSIMD_VECTORCALL nsimd_adds_sse42_f64(nsimd_sse42_vf64 a0, nsimd_sse42_vf64 a1);
nsimd_sse42_vf32 NSIMD_VECTORCALL nsimd_adds_sse42_f32(nsimd_sse42_vf32 a0, nsimd_sse42_vf32 a1);
nsimd_sse42_vf16 NSIMD_VECTORCALL nsimd_adds_sse42_f16(nsimd_sse42_vf16 a0, nsimd_sse42_vf16 a1);
nsimd_sse42_vi64 NSIMD_VECTORCALL nsimd_adds_sse42_i64(nsimd_sse42_vi64 a0, nsimd_sse42_vi64 a1);
nsimd_sse42_vi32 NSIMD_VECTORCALL nsimd_adds_sse42_i32(nsimd_sse42_vi32 a0, nsimd_sse42_vi32 a1);
nsimd_sse42_vi16 NSIMD_VECTORCALL nsimd_adds_sse42_i16(nsimd_sse42_vi16 a0, nsimd_sse42_vi16 a1);
nsimd_sse42_vi8 NSIMD_VECTORCALL nsimd_adds_sse42_i8(nsimd_sse42_vi8 a0, nsimd_sse42_vi8 a1);
nsimd_sse42_vu64 NSIMD_VECTORCALL nsimd_adds_sse42_u64(nsimd_sse42_vu64 a0, nsimd_sse42_vu64 a1);
nsimd_sse42_vu32 NSIMD_VECTORCALL nsimd_adds_sse42_u32(nsimd_sse42_vu32 a0, nsimd_sse42_vu32 a1);
nsimd_sse42_vu16 NSIMD_VECTORCALL nsimd_adds_sse42_u16(nsimd_sse42_vu16 a0, nsimd_sse42_vu16 a1);
nsimd_sse42_vu8 NSIMD_VECTORCALL nsimd_adds_sse42_u8(nsimd_sse42_vu8 a0, nsimd_sse42_vu8 a1);

SVE256

nsimd_sve256_vf64 NSIMD_VECTORCALL nsimd_adds_sve256_f64(nsimd_sve256_vf64 a0, nsimd_sve256_vf64 a1);
nsimd_sve256_vf32 NSIMD_VECTORCALL nsimd_adds_sve256_f32(nsimd_sve256_vf32 a0, nsimd_sve256_vf32 a1);
nsimd_sve256_vf16 NSIMD_VECTORCALL nsimd_adds_sve256_f16(nsimd_sve256_vf16 a0, nsimd_sve256_vf16 a1);
nsimd_sve256_vi64 NSIMD_VECTORCALL nsimd_adds_sve256_i64(nsimd_sve256_vi64 a0, nsimd_sve256_vi64 a1);
nsimd_sve256_vi32 NSIMD_VECTORCALL nsimd_adds_sve256_i32(nsimd_sve256_vi32 a0, nsimd_sve256_vi32 a1);
nsimd_sve256_vi16 NSIMD_VECTORCALL nsimd_adds_sve256_i16(nsimd_sve256_vi16 a0, nsimd_sve256_vi16 a1);
nsimd_sve256_vi8 NSIMD_VECTORCALL nsimd_adds_sve256_i8(nsimd_sve256_vi8 a0, nsimd_sve256_vi8 a1);
nsimd_sve256_vu64 NSIMD_VECTORCALL nsimd_adds_sve256_u64(nsimd_sve256_vu64 a0, nsimd_sve256_vu64 a1);
nsimd_sve256_vu32 NSIMD_VECTORCALL nsimd_adds_sve256_u32(nsimd_sve256_vu32 a0, nsimd_sve256_vu32 a1);
nsimd_sve256_vu16 NSIMD_VECTORCALL nsimd_adds_sve256_u16(nsimd_sve256_vu16 a0, nsimd_sve256_vu16 a1);
nsimd_sve256_vu8 NSIMD_VECTORCALL nsimd_adds_sve256_u8(nsimd_sve256_vu8 a0, nsimd_sve256_vu8 a1);

SVE1024

nsimd_sve1024_vf64 NSIMD_VECTORCALL nsimd_adds_sve1024_f64(nsimd_sve1024_vf64 a0, nsimd_sve1024_vf64 a1);
nsimd_sve1024_vf32 NSIMD_VECTORCALL nsimd_adds_sve1024_f32(nsimd_sve1024_vf32 a0, nsimd_sve1024_vf32 a1);
nsimd_sve1024_vf16 NSIMD_VECTORCALL nsimd_adds_sve1024_f16(nsimd_sve1024_vf16 a0, nsimd_sve1024_vf16 a1);
nsimd_sve1024_vi64 NSIMD_VECTORCALL nsimd_adds_sve1024_i64(nsimd_sve1024_vi64 a0, nsimd_sve1024_vi64 a1);
nsimd_sve1024_vi32 NSIMD_VECTORCALL nsimd_adds_sve1024_i32(nsimd_sve1024_vi32 a0, nsimd_sve1024_vi32 a1);
nsimd_sve1024_vi16 NSIMD_VECTORCALL nsimd_adds_sve1024_i16(nsimd_sve1024_vi16 a0, nsimd_sve1024_vi16 a1);
nsimd_sve1024_vi8 NSIMD_VECTORCALL nsimd_adds_sve1024_i8(nsimd_sve1024_vi8 a0, nsimd_sve1024_vi8 a1);
nsimd_sve1024_vu64 NSIMD_VECTORCALL nsimd_adds_sve1024_u64(nsimd_sve1024_vu64 a0, nsimd_sve1024_vu64 a1);
nsimd_sve1024_vu32 NSIMD_VECTORCALL nsimd_adds_sve1024_u32(nsimd_sve1024_vu32 a0, nsimd_sve1024_vu32 a1);
nsimd_sve1024_vu16 NSIMD_VECTORCALL nsimd_adds_sve1024_u16(nsimd_sve1024_vu16 a0, nsimd_sve1024_vu16 a1);
nsimd_sve1024_vu8 NSIMD_VECTORCALL nsimd_adds_sve1024_u8(nsimd_sve1024_vu8 a0, nsimd_sve1024_vu8 a1);

VSX

nsimd_vsx_vf64 NSIMD_VECTORCALL nsimd_adds_vsx_f64(nsimd_vsx_vf64 a0, nsimd_vsx_vf64 a1);
nsimd_vsx_vf32 NSIMD_VECTORCALL nsimd_adds_vsx_f32(nsimd_vsx_vf32 a0, nsimd_vsx_vf32 a1);
nsimd_vsx_vf16 NSIMD_VECTORCALL nsimd_adds_vsx_f16(nsimd_vsx_vf16 a0, nsimd_vsx_vf16 a1);
nsimd_vsx_vi64 NSIMD_VECTORCALL nsimd_adds_vsx_i64(nsimd_vsx_vi64 a0, nsimd_vsx_vi64 a1);
nsimd_vsx_vi32 NSIMD_VECTORCALL nsimd_adds_vsx_i32(nsimd_vsx_vi32 a0, nsimd_vsx_vi32 a1);
nsimd_vsx_vi16 NSIMD_VECTORCALL nsimd_adds_vsx_i16(nsimd_vsx_vi16 a0, nsimd_vsx_vi16 a1);
nsimd_vsx_vi8 NSIMD_VECTORCALL nsimd_adds_vsx_i8(nsimd_vsx_vi8 a0, nsimd_vsx_vi8 a1);
nsimd_vsx_vu64 NSIMD_VECTORCALL nsimd_adds_vsx_u64(nsimd_vsx_vu64 a0, nsimd_vsx_vu64 a1);
nsimd_vsx_vu32 NSIMD_VECTORCALL nsimd_adds_vsx_u32(nsimd_vsx_vu32 a0, nsimd_vsx_vu32 a1);
nsimd_vsx_vu16 NSIMD_VECTORCALL nsimd_adds_vsx_u16(nsimd_vsx_vu16 a0, nsimd_vsx_vu16 a1);
nsimd_vsx_vu8 NSIMD_VECTORCALL nsimd_adds_vsx_u8(nsimd_vsx_vu8 a0, nsimd_vsx_vu8 a1);

SVE128

nsimd_sve128_vf64 NSIMD_VECTORCALL nsimd_adds_sve128_f64(nsimd_sve128_vf64 a0, nsimd_sve128_vf64 a1);
nsimd_sve128_vf32 NSIMD_VECTORCALL nsimd_adds_sve128_f32(nsimd_sve128_vf32 a0, nsimd_sve128_vf32 a1);
nsimd_sve128_vf16 NSIMD_VECTORCALL nsimd_adds_sve128_f16(nsimd_sve128_vf16 a0, nsimd_sve128_vf16 a1);
nsimd_sve128_vi64 NSIMD_VECTORCALL nsimd_adds_sve128_i64(nsimd_sve128_vi64 a0, nsimd_sve128_vi64 a1);
nsimd_sve128_vi32 NSIMD_VECTORCALL nsimd_adds_sve128_i32(nsimd_sve128_vi32 a0, nsimd_sve128_vi32 a1);
nsimd_sve128_vi16 NSIMD_VECTORCALL nsimd_adds_sve128_i16(nsimd_sve128_vi16 a0, nsimd_sve128_vi16 a1);
nsimd_sve128_vi8 NSIMD_VECTORCALL nsimd_adds_sve128_i8(nsimd_sve128_vi8 a0, nsimd_sve128_vi8 a1);
nsimd_sve128_vu64 NSIMD_VECTORCALL nsimd_adds_sve128_u64(nsimd_sve128_vu64 a0, nsimd_sve128_vu64 a1);
nsimd_sve128_vu32 NSIMD_VECTORCALL nsimd_adds_sve128_u32(nsimd_sve128_vu32 a0, nsimd_sve128_vu32 a1);
nsimd_sve128_vu16 NSIMD_VECTORCALL nsimd_adds_sve128_u16(nsimd_sve128_vu16 a0, nsimd_sve128_vu16 a1);
nsimd_sve128_vu8 NSIMD_VECTORCALL nsimd_adds_sve128_u8(nsimd_sve128_vu8 a0, nsimd_sve128_vu8 a1);

VMX

nsimd_vmx_vf64 NSIMD_VECTORCALL nsimd_adds_vmx_f64(nsimd_vmx_vf64 a0, nsimd_vmx_vf64 a1);
nsimd_vmx_vf32 NSIMD_VECTORCALL nsimd_adds_vmx_f32(nsimd_vmx_vf32 a0, nsimd_vmx_vf32 a1);
nsimd_vmx_vf16 NSIMD_VECTORCALL nsimd_adds_vmx_f16(nsimd_vmx_vf16 a0, nsimd_vmx_vf16 a1);
nsimd_vmx_vi64 NSIMD_VECTORCALL nsimd_adds_vmx_i64(nsimd_vmx_vi64 a0, nsimd_vmx_vi64 a1);
nsimd_vmx_vi32 NSIMD_VECTORCALL nsimd_adds_vmx_i32(nsimd_vmx_vi32 a0, nsimd_vmx_vi32 a1);
nsimd_vmx_vi16 NSIMD_VECTORCALL nsimd_adds_vmx_i16(nsimd_vmx_vi16 a0, nsimd_vmx_vi16 a1);
nsimd_vmx_vi8 NSIMD_VECTORCALL nsimd_adds_vmx_i8(nsimd_vmx_vi8 a0, nsimd_vmx_vi8 a1);
nsimd_vmx_vu64 NSIMD_VECTORCALL nsimd_adds_vmx_u64(nsimd_vmx_vu64 a0, nsimd_vmx_vu64 a1);
nsimd_vmx_vu32 NSIMD_VECTORCALL nsimd_adds_vmx_u32(nsimd_vmx_vu32 a0, nsimd_vmx_vu32 a1);
nsimd_vmx_vu16 NSIMD_VECTORCALL nsimd_adds_vmx_u16(nsimd_vmx_vu16 a0, nsimd_vmx_vu16 a1);
nsimd_vmx_vu8 NSIMD_VECTORCALL nsimd_adds_vmx_u8(nsimd_vmx_vu8 a0, nsimd_vmx_vu8 a1);

AVX

nsimd_avx_vf64 NSIMD_VECTORCALL nsimd_adds_avx_f64(nsimd_avx_vf64 a0, nsimd_avx_vf64 a1);
nsimd_avx_vf32 NSIMD_VECTORCALL nsimd_adds_avx_f32(nsimd_avx_vf32 a0, nsimd_avx_vf32 a1);
nsimd_avx_vf16 NSIMD_VECTORCALL nsimd_adds_avx_f16(nsimd_avx_vf16 a0, nsimd_avx_vf16 a1);
nsimd_avx_vi64 NSIMD_VECTORCALL nsimd_adds_avx_i64(nsimd_avx_vi64 a0, nsimd_avx_vi64 a1);
nsimd_avx_vi32 NSIMD_VECTORCALL nsimd_adds_avx_i32(nsimd_avx_vi32 a0, nsimd_avx_vi32 a1);
nsimd_avx_vi16 NSIMD_VECTORCALL nsimd_adds_avx_i16(nsimd_avx_vi16 a0, nsimd_avx_vi16 a1);
nsimd_avx_vi8 NSIMD_VECTORCALL nsimd_adds_avx_i8(nsimd_avx_vi8 a0, nsimd_avx_vi8 a1);
nsimd_avx_vu64 NSIMD_VECTORCALL nsimd_adds_avx_u64(nsimd_avx_vu64 a0, nsimd_avx_vu64 a1);
nsimd_avx_vu32 NSIMD_VECTORCALL nsimd_adds_avx_u32(nsimd_avx_vu32 a0, nsimd_avx_vu32 a1);
nsimd_avx_vu16 NSIMD_VECTORCALL nsimd_adds_avx_u16(nsimd_avx_vu16 a0, nsimd_avx_vu16 a1);
nsimd_avx_vu8 NSIMD_VECTORCALL nsimd_adds_avx_u8(nsimd_avx_vu8 a0, nsimd_avx_vu8 a1);

C++ base API (architecture specifics)

AVX2

nsimd_avx2_vf64 NSIMD_VECTORCALL adds(nsimd_avx2_vf64 a0, nsimd_avx2_vf64 a1, f64, avx2);
nsimd_avx2_vf32 NSIMD_VECTORCALL adds(nsimd_avx2_vf32 a0, nsimd_avx2_vf32 a1, f32, avx2);
nsimd_avx2_vf16 NSIMD_VECTORCALL adds(nsimd_avx2_vf16 a0, nsimd_avx2_vf16 a1, f16, avx2);
nsimd_avx2_vi64 NSIMD_VECTORCALL adds(nsimd_avx2_vi64 a0, nsimd_avx2_vi64 a1, i64, avx2);
nsimd_avx2_vi32 NSIMD_VECTORCALL adds(nsimd_avx2_vi32 a0, nsimd_avx2_vi32 a1, i32, avx2);
nsimd_avx2_vi16 NSIMD_VECTORCALL adds(nsimd_avx2_vi16 a0, nsimd_avx2_vi16 a1, i16, avx2);
nsimd_avx2_vi8 NSIMD_VECTORCALL adds(nsimd_avx2_vi8 a0, nsimd_avx2_vi8 a1, i8, avx2);
nsimd_avx2_vu64 NSIMD_VECTORCALL adds(nsimd_avx2_vu64 a0, nsimd_avx2_vu64 a1, u64, avx2);
nsimd_avx2_vu32 NSIMD_VECTORCALL adds(nsimd_avx2_vu32 a0, nsimd_avx2_vu32 a1, u32, avx2);
nsimd_avx2_vu16 NSIMD_VECTORCALL adds(nsimd_avx2_vu16 a0, nsimd_avx2_vu16 a1, u16, avx2);
nsimd_avx2_vu8 NSIMD_VECTORCALL adds(nsimd_avx2_vu8 a0, nsimd_avx2_vu8 a1, u8, avx2);

SVE512

nsimd_sve512_vf64 NSIMD_VECTORCALL adds(nsimd_sve512_vf64 a0, nsimd_sve512_vf64 a1, f64, sve512);
nsimd_sve512_vf32 NSIMD_VECTORCALL adds(nsimd_sve512_vf32 a0, nsimd_sve512_vf32 a1, f32, sve512);
nsimd_sve512_vf16 NSIMD_VECTORCALL adds(nsimd_sve512_vf16 a0, nsimd_sve512_vf16 a1, f16, sve512);
nsimd_sve512_vi64 NSIMD_VECTORCALL adds(nsimd_sve512_vi64 a0, nsimd_sve512_vi64 a1, i64, sve512);
nsimd_sve512_vi32 NSIMD_VECTORCALL adds(nsimd_sve512_vi32 a0, nsimd_sve512_vi32 a1, i32, sve512);
nsimd_sve512_vi16 NSIMD_VECTORCALL adds(nsimd_sve512_vi16 a0, nsimd_sve512_vi16 a1, i16, sve512);
nsimd_sve512_vi8 NSIMD_VECTORCALL adds(nsimd_sve512_vi8 a0, nsimd_sve512_vi8 a1, i8, sve512);
nsimd_sve512_vu64 NSIMD_VECTORCALL adds(nsimd_sve512_vu64 a0, nsimd_sve512_vu64 a1, u64, sve512);
nsimd_sve512_vu32 NSIMD_VECTORCALL adds(nsimd_sve512_vu32 a0, nsimd_sve512_vu32 a1, u32, sve512);
nsimd_sve512_vu16 NSIMD_VECTORCALL adds(nsimd_sve512_vu16 a0, nsimd_sve512_vu16 a1, u16, sve512);
nsimd_sve512_vu8 NSIMD_VECTORCALL adds(nsimd_sve512_vu8 a0, nsimd_sve512_vu8 a1, u8, sve512);

SVE

nsimd_sve_vf64 NSIMD_VECTORCALL adds(nsimd_sve_vf64 a0, nsimd_sve_vf64 a1, f64, sve);
nsimd_sve_vf32 NSIMD_VECTORCALL adds(nsimd_sve_vf32 a0, nsimd_sve_vf32 a1, f32, sve);
nsimd_sve_vf16 NSIMD_VECTORCALL adds(nsimd_sve_vf16 a0, nsimd_sve_vf16 a1, f16, sve);
nsimd_sve_vi64 NSIMD_VECTORCALL adds(nsimd_sve_vi64 a0, nsimd_sve_vi64 a1, i64, sve);
nsimd_sve_vi32 NSIMD_VECTORCALL adds(nsimd_sve_vi32 a0, nsimd_sve_vi32 a1, i32, sve);
nsimd_sve_vi16 NSIMD_VECTORCALL adds(nsimd_sve_vi16 a0, nsimd_sve_vi16 a1, i16, sve);
nsimd_sve_vi8 NSIMD_VECTORCALL adds(nsimd_sve_vi8 a0, nsimd_sve_vi8 a1, i8, sve);
nsimd_sve_vu64 NSIMD_VECTORCALL adds(nsimd_sve_vu64 a0, nsimd_sve_vu64 a1, u64, sve);
nsimd_sve_vu32 NSIMD_VECTORCALL adds(nsimd_sve_vu32 a0, nsimd_sve_vu32 a1, u32, sve);
nsimd_sve_vu16 NSIMD_VECTORCALL adds(nsimd_sve_vu16 a0, nsimd_sve_vu16 a1, u16, sve);
nsimd_sve_vu8 NSIMD_VECTORCALL adds(nsimd_sve_vu8 a0, nsimd_sve_vu8 a1, u8, sve);

CPU

nsimd_cpu_vf64 NSIMD_VECTORCALL adds(nsimd_cpu_vf64 a0, nsimd_cpu_vf64 a1, f64, cpu);
nsimd_cpu_vf32 NSIMD_VECTORCALL adds(nsimd_cpu_vf32 a0, nsimd_cpu_vf32 a1, f32, cpu);
nsimd_cpu_vf16 NSIMD_VECTORCALL adds(nsimd_cpu_vf16 a0, nsimd_cpu_vf16 a1, f16, cpu);
nsimd_cpu_vi64 NSIMD_VECTORCALL adds(nsimd_cpu_vi64 a0, nsimd_cpu_vi64 a1, i64, cpu);
nsimd_cpu_vi32 NSIMD_VECTORCALL adds(nsimd_cpu_vi32 a0, nsimd_cpu_vi32 a1, i32, cpu);
nsimd_cpu_vi16 NSIMD_VECTORCALL adds(nsimd_cpu_vi16 a0, nsimd_cpu_vi16 a1, i16, cpu);
nsimd_cpu_vi8 NSIMD_VECTORCALL adds(nsimd_cpu_vi8 a0, nsimd_cpu_vi8 a1, i8, cpu);
nsimd_cpu_vu64 NSIMD_VECTORCALL adds(nsimd_cpu_vu64 a0, nsimd_cpu_vu64 a1, u64, cpu);
nsimd_cpu_vu32 NSIMD_VECTORCALL adds(nsimd_cpu_vu32 a0, nsimd_cpu_vu32 a1, u32, cpu);
nsimd_cpu_vu16 NSIMD_VECTORCALL adds(nsimd_cpu_vu16 a0, nsimd_cpu_vu16 a1, u16, cpu);
nsimd_cpu_vu8 NSIMD_VECTORCALL adds(nsimd_cpu_vu8 a0, nsimd_cpu_vu8 a1, u8, cpu);

SVE2048

nsimd_sve2048_vf64 NSIMD_VECTORCALL adds(nsimd_sve2048_vf64 a0, nsimd_sve2048_vf64 a1, f64, sve2048);
nsimd_sve2048_vf32 NSIMD_VECTORCALL adds(nsimd_sve2048_vf32 a0, nsimd_sve2048_vf32 a1, f32, sve2048);
nsimd_sve2048_vf16 NSIMD_VECTORCALL adds(nsimd_sve2048_vf16 a0, nsimd_sve2048_vf16 a1, f16, sve2048);
nsimd_sve2048_vi64 NSIMD_VECTORCALL adds(nsimd_sve2048_vi64 a0, nsimd_sve2048_vi64 a1, i64, sve2048);
nsimd_sve2048_vi32 NSIMD_VECTORCALL adds(nsimd_sve2048_vi32 a0, nsimd_sve2048_vi32 a1, i32, sve2048);
nsimd_sve2048_vi16 NSIMD_VECTORCALL adds(nsimd_sve2048_vi16 a0, nsimd_sve2048_vi16 a1, i16, sve2048);
nsimd_sve2048_vi8 NSIMD_VECTORCALL adds(nsimd_sve2048_vi8 a0, nsimd_sve2048_vi8 a1, i8, sve2048);
nsimd_sve2048_vu64 NSIMD_VECTORCALL adds(nsimd_sve2048_vu64 a0, nsimd_sve2048_vu64 a1, u64, sve2048);
nsimd_sve2048_vu32 NSIMD_VECTORCALL adds(nsimd_sve2048_vu32 a0, nsimd_sve2048_vu32 a1, u32, sve2048);
nsimd_sve2048_vu16 NSIMD_VECTORCALL adds(nsimd_sve2048_vu16 a0, nsimd_sve2048_vu16 a1, u16, sve2048);
nsimd_sve2048_vu8 NSIMD_VECTORCALL adds(nsimd_sve2048_vu8 a0, nsimd_sve2048_vu8 a1, u8, sve2048);

NEON128

nsimd_neon128_vf64 NSIMD_VECTORCALL adds(nsimd_neon128_vf64 a0, nsimd_neon128_vf64 a1, f64, neon128);
nsimd_neon128_vf32 NSIMD_VECTORCALL adds(nsimd_neon128_vf32 a0, nsimd_neon128_vf32 a1, f32, neon128);
nsimd_neon128_vf16 NSIMD_VECTORCALL adds(nsimd_neon128_vf16 a0, nsimd_neon128_vf16 a1, f16, neon128);
nsimd_neon128_vi64 NSIMD_VECTORCALL adds(nsimd_neon128_vi64 a0, nsimd_neon128_vi64 a1, i64, neon128);
nsimd_neon128_vi32 NSIMD_VECTORCALL adds(nsimd_neon128_vi32 a0, nsimd_neon128_vi32 a1, i32, neon128);
nsimd_neon128_vi16 NSIMD_VECTORCALL adds(nsimd_neon128_vi16 a0, nsimd_neon128_vi16 a1, i16, neon128);
nsimd_neon128_vi8 NSIMD_VECTORCALL adds(nsimd_neon128_vi8 a0, nsimd_neon128_vi8 a1, i8, neon128);
nsimd_neon128_vu64 NSIMD_VECTORCALL adds(nsimd_neon128_vu64 a0, nsimd_neon128_vu64 a1, u64, neon128);
nsimd_neon128_vu32 NSIMD_VECTORCALL adds(nsimd_neon128_vu32 a0, nsimd_neon128_vu32 a1, u32, neon128);
nsimd_neon128_vu16 NSIMD_VECTORCALL adds(nsimd_neon128_vu16 a0, nsimd_neon128_vu16 a1, u16, neon128);
nsimd_neon128_vu8 NSIMD_VECTORCALL adds(nsimd_neon128_vu8 a0, nsimd_neon128_vu8 a1, u8, neon128);

AVX512_SKYLAKE

nsimd_avx512_skylake_vf64 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vf64 a0, nsimd_avx512_skylake_vf64 a1, f64, avx512_skylake);
nsimd_avx512_skylake_vf32 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vf32 a0, nsimd_avx512_skylake_vf32 a1, f32, avx512_skylake);
nsimd_avx512_skylake_vf16 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vf16 a0, nsimd_avx512_skylake_vf16 a1, f16, avx512_skylake);
nsimd_avx512_skylake_vi64 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vi64 a0, nsimd_avx512_skylake_vi64 a1, i64, avx512_skylake);
nsimd_avx512_skylake_vi32 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vi32 a0, nsimd_avx512_skylake_vi32 a1, i32, avx512_skylake);
nsimd_avx512_skylake_vi16 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vi16 a0, nsimd_avx512_skylake_vi16 a1, i16, avx512_skylake);
nsimd_avx512_skylake_vi8 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vi8 a0, nsimd_avx512_skylake_vi8 a1, i8, avx512_skylake);
nsimd_avx512_skylake_vu64 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vu64 a0, nsimd_avx512_skylake_vu64 a1, u64, avx512_skylake);
nsimd_avx512_skylake_vu32 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vu32 a0, nsimd_avx512_skylake_vu32 a1, u32, avx512_skylake);
nsimd_avx512_skylake_vu16 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vu16 a0, nsimd_avx512_skylake_vu16 a1, u16, avx512_skylake);
nsimd_avx512_skylake_vu8 NSIMD_VECTORCALL adds(nsimd_avx512_skylake_vu8 a0, nsimd_avx512_skylake_vu8 a1, u8, avx512_skylake);

AARCH64

nsimd_aarch64_vf64 NSIMD_VECTORCALL adds(nsimd_aarch64_vf64 a0, nsimd_aarch64_vf64 a1, f64, aarch64);
nsimd_aarch64_vf32 NSIMD_VECTORCALL adds(nsimd_aarch64_vf32 a0, nsimd_aarch64_vf32 a1, f32, aarch64);
nsimd_aarch64_vf16 NSIMD_VECTORCALL adds(nsimd_aarch64_vf16 a0, nsimd_aarch64_vf16 a1, f16, aarch64);
nsimd_aarch64_vi64 NSIMD_VECTORCALL adds(nsimd_aarch64_vi64 a0, nsimd_aarch64_vi64 a1, i64, aarch64);
nsimd_aarch64_vi32 NSIMD_VECTORCALL adds(nsimd_aarch64_vi32 a0, nsimd_aarch64_vi32 a1, i32, aarch64);
nsimd_aarch64_vi16 NSIMD_VECTORCALL adds(nsimd_aarch64_vi16 a0, nsimd_aarch64_vi16 a1, i16, aarch64);
nsimd_aarch64_vi8 NSIMD_VECTORCALL adds(nsimd_aarch64_vi8 a0, nsimd_aarch64_vi8 a1, i8, aarch64);
nsimd_aarch64_vu64 NSIMD_VECTORCALL adds(nsimd_aarch64_vu64 a0, nsimd_aarch64_vu64 a1, u64, aarch64);
nsimd_aarch64_vu32 NSIMD_VECTORCALL adds(nsimd_aarch64_vu32 a0, nsimd_aarch64_vu32 a1, u32, aarch64);
nsimd_aarch64_vu16 NSIMD_VECTORCALL adds(nsimd_aarch64_vu16 a0, nsimd_aarch64_vu16 a1, u16, aarch64);
nsimd_aarch64_vu8 NSIMD_VECTORCALL adds(nsimd_aarch64_vu8 a0, nsimd_aarch64_vu8 a1, u8, aarch64);

AVX512_KNL

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SSE2

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SSE42

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SVE256

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SVE1024

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VSX

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SVE128

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VMX

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AVX

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